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- DDR3总线信号完整性测试需要关注4点DDR总线需要测试时钟、命令/地址、数据等,数据测试是难点,而关键参数是建立时间和保持时间,所以需要对读写信号进行分离,分离后分别测试读和写信号的建立时间和保持时间。2014-09-167228
- 特性阻抗,特性阻抗对在信号完整性中的作用和位置当信号在传输线上传播时,信号感受到的瞬态阻抗与单位长度电容和材料的介电常数有关2014-09-166223
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- 高速电路设计和信号完整性分析随着技术的进步,目前高速集成电路的信号切拘时间已经达到几百ps,时钟频率也可达到几百MHz如此高的边沿速率导致印刷电路板上的大量互连线产生低速电路中所没有的传输线效应,使信号产生失真,严重影响信号的正确传输...2014-09-166439