高速PCB的终端端接在高速PCB数字电路系统中，传输线上阻抗不匹配会造成信号反射，并出现过冲、下冲和振铃等信号畸变，而当传输线的时延TD大于信号上升时间RT的20％时，反射的影响就不能忽视了，不然将带来信号完整性问题...
2014/09/19
5971- 如何避免高速PCB设计中传输线效应？很好地解决信号完整性问题将改善PCB板的电磁兼容性(EMC)。其中非常重要的是保证PCB板有很好的接地。对复杂的设计采用一个信号层配一个地线层是十分有效的方法。此外，使电路板的最外层信号的密度最小也是减少电磁辐射的好方法，这种方法可采用"表面积层"技术"Build-up"设计制做PCB来实现...2014/09/195092
- 基于信号完整性分析的高速PCB设计信号完整性是指电路系统中信号的质量。如果在要求的时间内，信号能够不失真地从源端传送到接收端，就称该信号是完整的。随着半导体工艺的迅猛发展、IC开关输出速度的提高，信号完整性问题(包括信号过冲与下冲、振铃、反射、串扰、地弹等)已成为高速PCB设计必须关注的问题之一...2014/09/198386
- 基于高速PCB互连设计中的测试技术讲解PCB互连设计技术包括测试、仿真以及各种相关标准，其中测试是验证各种仿真分析结果的方法和手段。优秀的测试方法和手段是保证PCB互连设计分析的必要条件，对于传统的信号波形测试，主要应当关注的是探头引线的长度...2014/09/187227
- 高速PCB可控性与电磁兼容性设计随着系统设计复杂性和集成度的大规模提高，电子系统设计师们正在从事100MHZ以上的电路设计，总线的工作频率也已经达到或者超过50MHZ，有的甚至超过100MHZ。目前约50% 的设计的时钟频率超过50MHz，将近20% 的设计主频超过120MHz...2014/09/185394
